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CPU버스/I/O 제어 방식 4.3"(480×272) TFTLCD 모듈(V2.1) (P0224)
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[]CPU버스/I/O 제어 방식 4.3"(480×272) TFTLCD 모듈(V2.1) (P0224)

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기본 정보
상품명 CPU버스/I/O 제어 방식 4.3"(480×272) TFTLCD 모듈(V2.1) (P0224)
상품코드 P0224-D21
제조사 CHINA
판매가 80,300원 (부가세 미포함)
배송비 2,800원 (77,000원 이상 구매 시 무료)

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CPU버스/I/O 제어 방식 4.3"(480×272) TFTLCD 모듈(V2.1) (P0224) 수량증가 수량감소 80300 (  )
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상품상세정보


와이드 4.3 인치 480 x 272 해상도, 터치판넬형TFTLCD 모듈입니다. SSD1963을 내장하여 AVR, PIC, 
C51, ARM 등의 CPU에서 손쉽게 제어할 수 있습니다. 터치 콘트롤러 TSC2046, LCD 콘트롤러 SSD1963, 
mini-SDcard용 소켓, 시리얼 16M Bit 플래쉬 메모리(25Q16)등이 장착되어 있습니다. 




  • SSD1963 디스플레이 컨트롤러 칩
  • 24비트 RGB 인터페이스(표준 40핀 인터페이스)
  • 표시색상 : 16만
  • 화면크기 : 4.3" (16:9)
  • 화면해상도 : 480×272 픽셀
  • Mini-SD 메모리 카드 지원
  • 16Mbit Serial Flash(25Q16) 메모리 탑재
  • 터치스크린, 터치 컨트롤칩(TSC2046) 내장
  • STM32F103ZE, STM32F103VC, STM32F107VC 개발보드와 pip to pin 호완
  • 낮은 전력소비

















※이미지를 클릭하면 다운로드 됩니다












<초기화코드 간략예제>

* Full code(STM32, Keil Compiler 4.xx Ver 에서 컴파일 코드는 제공문서를 참조 바랍니다.


void LCD_WR_REG(u8 data)

LCD_RS=0;
LCD_CS=0; 
DATAOUT(data); 
LCD_WR=0; 
LCD_WR=1; 
LCD_CS=1; 


void LCD_WriteReg(u8 LCD_Reg, u16 LCD_RegValue)

LCD_WR_REG(LCD_Reg); 
LCD_WR_DATA(LCD_RegValue); 


u16 LCD_ReadReg(u8 LCD_Reg)

u16 t;
LCD_WR_REG(LCD_Reg); 
GPIOE->CRL=0X88888888;
GPIOE->CRH=0X88888888;
GPIOE->ODR=0XFFFF; 
LCD_RS=1;
LCD_CS=0;
LCD_RD=0; 
LCD_RD=1;
t=DATAIN; 
LCD_CS=1; 
GPIOE->CRL=0X33333333; 
GPIOE->CRH=0X33333333; 
GPIOE->ODR=0XFFFF; 
return t; 


void LCD_WriteRAM_Prepare(void)
{
LCD_WR_REG(R34);


void LCD_WriteRAM(u16 RGB_Code)

LCD_WR_DATA(RGB_Code);
}

u16 LCD_BGR2RGB(u16 c)
{
u16 r,g,b,rgb; 
b=(c>>0)&0x1f;
g=(c>>5)&0x3f;
r=(c>>11)&0x1f; 
rgb=(b<<11)+(g<<5)+(r<<0); 
return(rgb);


void LCD_Init(void)
{
RCC->APB2ENR|=1<<5; 
RCC->APB2ENR|=1<<6; 
RCC->APB2ENR|=1<<0; 
GPIOD->CRH&=0X0000FFFF;
GPIOD->CRH|=0X33330000; 
GPIOD->ODR|=0XF000;
GPIOE->CRH=0X33333333;
GPIOE->CRL=0X33333333; 
GPIOE->ODR=0XFFFF;
 
Delay(5); // delay 50 ms 
LCD_WR_REG(0x00E2); //PLL multiplier, set PLL clock to 120M
LCD_WR_DATA(0x0023); //N=0x36 for 6.5M, 0x23 for 10M crystal
LCD_WR_DATA(0x0002);
LCD_WR_DATA(0x0004); 
LCD_WR_REG(0x00E0); // PLL enable
LCD_WR_DATA(0x0001);
delay_time(1);
LCD_WR_REG(0x00E0);
LCD_WR_DATA(0x0003);
delay_time(5);
LCD_WR_REG(0x0001); // software reset
delay_time(5);
LCD_WR_REG(0x00E6); //PLL setting for PCLK, depends on resolution
LCD_WR_DATA(0x0001);
LCD_WR_DATA(0x0033);
LCD_WR_DATA(0x0032);
LCD_WR_REG(0x00B0); //LCD SPECIFICATION
LCD_WR_DATA(0x0020);
LCD_WR_DATA(0x0000);
LCD_WR_DATA((HDP>>8)&0X00FF); //Set HDP
LCD_WR_DATA(HDP&0X00FF);
LCD_WR_DATA((VDP>>8)&0X00FF); //Set VDP
LCD_WR_DATA(VDP&0X00FF);
LCD_WR_DATA(0x0000);
LCD_WR_REG(0x00B4); //HSYNC
LCD_WR_DATA((HT>>8)&0X00FF); //Set HT
LCD_WR_DATA(HT&0X00FF);
LCD_WR_DATA((HPS>>8)&0X00FF); //Set HPS
LCD_WR_DATA(HPS&0X00FF);
LCD_WR_DATA(HPW); //Set HPW
LCD_WR_DATA((LPS>>8)&0X00FF); //Set HPS
LCD_WR_DATA(LPS&0X00FF);
LCD_WR_DATA(0x0000);
LCD_WR_REG(0x00B6); //VSYNC
LCD_WR_DATA((VT>>8)&0X00FF); //Set VT
LCD_WR_DATA(VT&0X00FF);
LCD_WR_DATA((VPS>>8)&0X00FF); //Set VPS
LCD_WR_DATA(VPS&0X00FF);
LCD_WR_DATA(VPW); //Set VPW
LCD_WR_DATA((FPS>>8)&0X00FF); //Set FPS
LCD_WR_DATA(FPS&0X00FF);
LCD_WR_REG(0x00F0); //pixel data interface
LCD_WR_DATA(0x0002);
LCD_WR_REG(0x0021); 
LCD_WR_REG(0x00BC);
LCD_WR_DATA(0x0080);
LCD_WR_DATA(0x0080);
LCD_WR_DATA(0x0080);
LCD_WR_DATA(0x0001);
LCD_Clear(BLACK);
LCD_WR_REG(0x0029); //display on 
Delay(5000);



















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